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文檔簡介
1、本文提出了一種以FPGA為核心的實(shí)時(shí)視頻圖像采集存儲(chǔ)和網(wǎng)絡(luò)傳輸顯示系統(tǒng)的設(shè)計(jì)。Verilog編程設(shè)計(jì)用于A/D配置視頻解碼，視頻圖像采集邏輯控制和圖像存儲(chǔ)邏輯控制等模塊。首先概括了網(wǎng)絡(luò)視頻傳輸系統(tǒng)相關(guān)的研究現(xiàn)狀及趨勢(shì)，介紹了本系統(tǒng)的總體設(shè)計(jì)及設(shè)計(jì)過程中所使用到的相關(guān)技術(shù)，然后重點(diǎn)介紹了FPGA平臺(tái)下自上而下各個(gè)功能模塊的劃分與設(shè)計(jì)。本系統(tǒng)的圖像制式為PAL，輸出的是ITU-656灰度數(shù)字視頻流，像素時(shí)鐘為13.5MHz，幀圖像大小為36
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