2023年全國碩士研究生考試考研英語一試題真題（含答案詳解+作文范文）_第1頁
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文檔簡介

1、FPGA的集成度越來越高,內(nèi)部資源越來越豐富,可實(shí)現(xiàn)的功能也越來越多,開發(fā)難度越來越大。使用傳統(tǒng)的FPGA開發(fā)流程,需要專門的設(shè)計(jì)人員把C/C++語言等高級語言建模的算法使用硬件描述語言進(jìn)行RTL級建模,由于硬件描述語言和高級語言在對同一算法的實(shí)現(xiàn)上有比較大的差別,因此RTL級代碼設(shè)計(jì)人員一旦對算法的理解不完全正確,就可能導(dǎo)致算法無法正確實(shí)現(xiàn)。另外RTL代碼調(diào)試也需要較長的時間。上述因素導(dǎo)致開發(fā)難度增加,開發(fā)周期加長。因此需要一種效率更

2、高的開發(fā)流程實(shí)現(xiàn)日趨復(fù)雜的FPGA項(xiàng)目的開發(fā)。
　　 Mentor公司的C語言算法綜合器——Catapult SL Synthesis可以把非定時的C/C++算法綜合成RTL級網(wǎng)表,從而省去了設(shè)計(jì)者編寫RTL級代碼和調(diào)試代碼的時間,提高了FPGA開發(fā)的效率。
　　 本文對Mentor Graphics公司的Catapult SL Synthesis做了詳細(xì)的介紹和研究,并通過分別使用傳統(tǒng)的FPGA開發(fā)流程和使用Catap

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