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1、本文基于SoPC設(shè)計(jì)方式對(duì)G.726 ADPCM語(yǔ)音編/解碼器進(jìn)行了設(shè)計(jì)和應(yīng)用。在參考相關(guān)文獻(xiàn)的基礎(chǔ)上,結(jié)合SoPC設(shè)計(jì)要求,對(duì)G.726 ADPCM算法進(jìn)行了適當(dāng)調(diào)整和簡(jiǎn)化,得到一種較實(shí)用的G.726編/解碼器。G.726編/解碼器總體建模采用DSF Builder工具,將算法級(jí)和RTL級(jí)設(shè)計(jì)有機(jī)結(jié)合起來(lái)。使用DSF,Builder標(biāo)準(zhǔn)庫(kù)元件構(gòu)建白適應(yīng)量化器、自適應(yīng)預(yù)測(cè)器、逆自適應(yīng)量化器和量化器定標(biāo)因子自適應(yīng)等功能模塊,對(duì)于優(yōu)先編碼器
2、等庫(kù)中沒(méi)有的子模塊,則采用VHDL進(jìn)行描述和建模。為減少運(yùn)算量,G.726編/解碼器中對(duì)數(shù)運(yùn)算等相關(guān)非線性函數(shù)采用查找表實(shí)現(xiàn),不可避免帶來(lái)了面積的增加。在模型仿真功能正確的基礎(chǔ)上,利用SignalCompiler將G.726編/解碼器模型轉(zhuǎn)換為RTL級(jí)VHDL代碼。并使用ModelSim對(duì)該硬件描述進(jìn)行功能仿真。最后,在Quallus Ⅱ中完成G726編/解碼器的靜態(tài)時(shí)序分析等驗(yàn)證工作。結(jié)果顯示,G.726編/解碼器功能良好,失真較小,
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