AVS視頻解碼器行為級(jí)模型設(shè)計(jì).pdf_第1頁(yè)
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1、為了促進(jìn)我國(guó)音視頻相關(guān)產(chǎn)業(yè)的產(chǎn)業(yè)升級(jí)和發(fā)展，2002年6月國(guó)家信息產(chǎn)業(yè)部科學(xué)技術(shù)司批準(zhǔn)成立AVS工作組，負(fù)責(zé)制定我國(guó)的數(shù)字音視頻編碼標(biāo)準(zhǔn)。2006年3月AVS第二部分標(biāo)準(zhǔn)AVS-P2正式公布，它主要針對(duì)高清晰度數(shù)字電視廣播和高密度存儲(chǔ)媒體應(yīng)用。 System Verilog是一種系統(tǒng)級(jí)硬件設(shè)計(jì)和建模語(yǔ)言，它引入了面向?qū)ο蟮脑O(shè)計(jì)思想，OVM是Cadence和Mentor公司以Systemverilog為基礎(chǔ)開(kāi)發(fā)的一套用于硬件建模和

2、驗(yàn)證的源碼開(kāi)放的方法學(xué)，它提供了一套完成的事務(wù)級(jí)建模機(jī)制。本文利用OVM完成了AVS視頻解碼器的TLM級(jí)建模，為后續(xù)的RTL級(jí)設(shè)計(jì)及驗(yàn)證提供了一個(gè)參考模型。 本文主要內(nèi)容包括以下幾個(gè)方面： 1．介紹了當(dāng)前視頻壓縮標(biāo)準(zhǔn)的發(fā)展以及開(kāi)發(fā)AVS視頻解碼芯片的必要性，分析了SoC設(shè)計(jì)的流程及系統(tǒng)級(jí)建模在SOC設(shè)計(jì)階段的作用。 2．對(duì)AVS視頻解碼軟件進(jìn)行運(yùn)算復(fù)雜度分析，提出了AVS視頻解碼器的軟硬件劃分以及流水線劃分方案。

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