2023年全國(guó)碩士研究生考試考研英語(yǔ)一試題真題（含答案詳解+作文范文）_第1頁(yè)
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1、在電力電子開(kāi)關(guān)變換器數(shù)字化共模噪聲抑制系統(tǒng)中，一個(gè)重要環(huán)節(jié)就是共模噪聲的評(píng)估。由于共模噪聲電流振蕩頻率很高，基于DSP的采樣控制很難滿足要求。本文提出了用FPGA作為主要器件、以能量為指標(biāo)的共模噪聲評(píng)估技術(shù)。所提方案中，F(xiàn)PGA可完成對(duì)高速AD芯片的采樣控制、讀取采樣值、計(jì)算共模電流的噪聲能量值并將該值反饋給DSP。
　　 本文的主要內(nèi)容有：共模變壓器的設(shè)計(jì)，硬件電路的設(shè)計(jì)，F(xiàn)PGA功能設(shè)計(jì)，以及FPGA的配置和調(diào)試。欲采集共模

2、電流信號(hào)，首先需要設(shè)計(jì)共模變壓器，將主電路輸入端的共模電流通過(guò)耦合，轉(zhuǎn)化為電壓信號(hào)，才能進(jìn)行模數(shù)轉(zhuǎn)換和共模信號(hào)采樣。共模變壓器的設(shè)計(jì)與制作是共模噪聲檢測(cè)的關(guān)鍵內(nèi)容之一，在此處，共模變壓器采用磁性元件的一般設(shè)計(jì)原則及公式設(shè)計(jì)的。硬件電路的設(shè)計(jì)包括器件選擇和FPGA電路板的設(shè)計(jì)：選擇MAX1448作為本系統(tǒng)所用A/D芯片，F(xiàn)PGA器件選擇EP1C3T144C8。設(shè)計(jì)線路板需要考慮一些高速信號(hào)電路設(shè)計(jì)的問(wèn)題。FPGA功能設(shè)計(jì)在本系統(tǒng)中采用自下

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