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文檔簡介
1、在短波通信系統(tǒng)中,由于多徑效應(yīng)常常引起信道衰落,直接結(jié)果是碼間串?dāng)_非常嚴(yán)重.為了克服碼間串?dāng)_所帶來的信號(hào)畸變,必須在接收端增加均衡器,以補(bǔ)償信道特性,正確恢復(fù)發(fā)送序列.本文首先對(duì)DDLMS算法進(jìn)行了浮點(diǎn)和定點(diǎn)仿真,確定了內(nèi)部節(jié)點(diǎn)的字長,分析了迭代步長、濾波器階數(shù)、抽頭系數(shù)的初始化等因素對(duì)均衡器性能的影響.接著,根據(jù)上述仿真的結(jié)果,以FPGA為平臺(tái),利用Verilog HDL語言,使用TOP-DOWN的數(shù)字系統(tǒng)設(shè)計(jì)方法,實(shí)現(xiàn)了基于Buss
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