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文檔簡介
1、本論文采用基于片上可編程系統(tǒng)(SOPC)的Nios Ⅱ嵌入式處理器實現(xiàn)中國數(shù)字電視地面?zhèn)鬏敇藴式邮諜C同步系統(tǒng)。以Stratix系列的EPlSSOF1020C5 FPGA(現(xiàn)場可編程門陣列)為基礎構建了硬件處理平臺,完成了整個系統(tǒng)同步的硬件設計。本文首先概述了數(shù)字電視的國內(nèi)外發(fā)展現(xiàn)狀,再介紹了數(shù)字電視國家標準發(fā)射端系統(tǒng)的整體結構以及接收機系統(tǒng)整體架構。重點介紹了數(shù)字電視國家標準接收機同步算法和基于Nios Ⅱ的FPGA結構設計,并根據(jù)數(shù)字
2、電視國家標準信號幀的結構特點分析了包括頻率同步、采樣同步和符號同步在內(nèi)的時域同步算法,提出了相位匹配處理模式;同時介紹了殘余頻偏校正的原理和硬件設計。本文還詳細地介紹了同步系統(tǒng)通用算法的軟硬件設計。得出了基于SPW(信號處理工作站)的接收機同步系統(tǒng)的硬件仿真設計結果和整個接收機同步系統(tǒng)的片上調(diào)試結果。本文所完成的主要工作有: 1.閱讀相關文獻資料,掌握中國數(shù)字電視地面?zhèn)鬏敇藴实恼w結構和原理。 2.完成了數(shù)字電視國家標準
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