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文檔簡(jiǎn)介
1、論文首先介紹了HFC接入網(wǎng)及其相關(guān)的DOCSIS1.1協(xié)議(HFC網(wǎng)絡(luò)數(shù)據(jù)傳輸系統(tǒng)技術(shù)規(guī)范)。在此基礎(chǔ)上深入研究DOCSIS1.1協(xié)議中的信號(hào)處理的關(guān)鍵技術(shù),包括RS編碼和QPSK調(diào)制解調(diào)技術(shù)。
在DOCSIS1.1協(xié)議中規(guī)定上行信道處理中的參數(shù)是從下行信道中傳送過(guò)來(lái)的,因此本論文分析了下行信道中MAC層的MAC幀的格式,用基于NiosⅡ的SOPC技術(shù)實(shí)現(xiàn)了對(duì)上行信道描述符的解析。在硬件的實(shí)現(xiàn)上采用Altera公司的FPG
2、A,軟件在NiosⅡ IDE中設(shè)計(jì)運(yùn)行。利用SOPC技術(shù)可以使設(shè)計(jì)周期大為縮短,系統(tǒng)靈活性也大為增強(qiáng),而且設(shè)計(jì)成本很低。
RS碼是一種典型的糾錯(cuò)碼,在線性分組碼中具有最強(qiáng)的糾錯(cuò)能力,既能糾正隨機(jī)錯(cuò)誤,也能糾正突發(fā)錯(cuò)誤,獲得了廣泛的實(shí)際應(yīng)用。論文研究了RS編碼器的硬件實(shí)現(xiàn)方法。在RS編碼器的設(shè)計(jì)中,利用有限域常數(shù)乘法器的特性對(duì)編碼電路進(jìn)行優(yōu)化。用Verilog語(yǔ)言對(duì)RS編碼器進(jìn)行描述,并在Modelsim中進(jìn)行了仿真,仿真的
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