2023年全國(guó)碩士研究生考試考研英語(yǔ)一試題真題(含答案詳解+作文范文)_第1頁(yè)
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1、電工電子技術(shù)電工電子技術(shù)B復(fù)習(xí)題復(fù)習(xí)題一、填空題1.PN結(jié)在(正向電壓)時(shí)導(dǎo)通,(反向電壓)時(shí)截止,這種特性稱為(單向?qū)щ娦裕?.某處于放大狀態(tài)的三極管,測(cè)得三個(gè)電極的對(duì)地電位為U1=9V,U2=6V,U3=6.2V,則電極(u3)為基極,(u1)為集電極,(u2)為發(fā)射極,為(PNP)型管。3.三極管工作在放大區(qū)時(shí),發(fā)射結(jié)為(正向)偏置,集電結(jié)為(反向)偏置。4.某放大電路中,測(cè)得三極管三個(gè)電極的電流為IA=2mA,IB=0.04m

2、A,IC=2.04mA,則電極(IB)為基極,(IA)為集電極,(IC)為發(fā)射極;(50)。??5.負(fù)反饋雖然使放大器的放大倍數(shù)下降,但能(提高)放大倍數(shù)的穩(wěn)定性,(擴(kuò)展)通頻帶,(減少)非線性失真,(變換)放大器的輸入、輸出電阻。6.集成運(yùn)放用作電壓比較器時(shí),應(yīng)工作于(開)環(huán)狀態(tài)或引入(正)反饋。7.(10001001)2=(89)16=(137)10=(211)8。8.對(duì)十個(gè)信號(hào)進(jìn)行編碼,則轉(zhuǎn)換成的二進(jìn)制代碼至少應(yīng)有(4)位。9.1

3、個(gè)觸發(fā)器可以記憶(1)位二進(jìn)制信息,1個(gè)觸發(fā)器的穩(wěn)定狀態(tài)有(1)和(0)狀態(tài)。10.555定時(shí)器構(gòu)成的單穩(wěn)態(tài)觸發(fā)器有(1)個(gè)穩(wěn)態(tài)、構(gòu)成的多諧振蕩器有(0)個(gè)穩(wěn)態(tài)。11.二極管在(正向電壓)時(shí)導(dǎo)通,(反向電壓)時(shí)截止,這種特性稱為(單向?qū)щ娦裕?2.某處于放大狀態(tài)的三極管,測(cè)得三個(gè)電極的對(duì)地電位為U1=6.7V,U2=6V,U3=9V,則電極(U1)為基極,(U3)為集電極,(U2)為發(fā)射極,為(NPN)型管。13.三極管工作在飽和狀態(tài)

4、時(shí),發(fā)射結(jié)為(正向)偏置,集電結(jié)為(正向)偏置。14.某放大電路中,測(cè)得三極管三個(gè)電極的電流為IC=2mA,IA=0.04mA,IB=2.04mA,則電極(IA)為基極,(IC)為集電極,(IB)為發(fā)射極;(50)。??15.(負(fù)反饋)雖然使放大器的放大倍數(shù)下降,但能提高放大倍數(shù)的穩(wěn)定性,減小非線性失真。16.集成運(yùn)放線應(yīng)用時(shí),應(yīng)引入(深度負(fù))反饋。17.(1001001)2=(49)16=(73)10=(111)8。18.555定時(shí)器

5、構(gòu)成(單穩(wěn)態(tài)觸發(fā)器)時(shí)有一個(gè)穩(wěn)態(tài)、構(gòu)成(多諧振蕩器)時(shí)無(wú)穩(wěn)定狀態(tài)。19.十進(jìn)制數(shù)128對(duì)應(yīng)的二進(jìn)制數(shù)是(10000000),對(duì)應(yīng)8421BCD碼是(000100101000),對(duì)應(yīng)的十六進(jìn)制數(shù)是(80)。20.邏輯函數(shù)??????DCBADCBAY(1)。21.對(duì)十個(gè)信號(hào)進(jìn)行編碼,則轉(zhuǎn)換成的二進(jìn)制代碼至少應(yīng)有(4)位。22.在TTL門電路中,輸入端懸空在邏輯上等效于輸入(高)電平。13.為了向負(fù)載提供較大功率,放大電路的輸出級(jí)應(yīng)采用(A

6、)A共射極放大電路B差分放大電路C功率放大電路D復(fù)合管放大電路14.要同時(shí)得到12V和9V的固定電壓輸出,應(yīng)采用的三端穩(wěn)壓器分別為(D)。A.CW7812;CW7909B.CW7812;CW7809C.CW7912;CW7909D.CW7912;CW780915.直接耦合放大電路,(B)信號(hào)。A.只能放大交流信號(hào)B.既能放大交流信號(hào),也能放大直流信號(hào)C.只能放大直流信號(hào)D.既不能放大交流信號(hào),也不能放大直流信號(hào).16.在下列邏輯電路中,

7、是組合邏輯電路的有(D)。A、觸發(fā)器B、寄存器C、全加器D、計(jì)數(shù)器17.在什么情況下“與非”運(yùn)算的結(jié)果為0(B)。A、輸入全為0B、輸入全為1C、有0輸入D、有1輸入18.若已知,則(C)ACABCABA????AB=C=0BB=C=1CB=CDBC?19.輸出端可直接連在一起實(shí)現(xiàn)“線與’’邏輯功能的門電路是(D)。A與非門B或非門C三態(tài)門DOC門19.存在約束條件的觸發(fā)器是(A)。ARS觸發(fā)器BD觸發(fā)器CJK觸發(fā)器DT觸發(fā)器20.有四

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