VDES的調(diào)制解調(diào)算法與實現(xiàn)研究.pdf_第1頁
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文檔簡介

1、甚高頻數(shù)據(jù)交換系統(tǒng)VDES(VDES: VHF Data Exchange System)是一種新型的數(shù)字通信系統(tǒng)，該系統(tǒng)是在船舶自動識別系統(tǒng)AIS(AIS:AutomaticIdentification System)上發(fā)展起來的新一代海上數(shù)字通信系統(tǒng)。VDES作為一種新型數(shù)字通信系統(tǒng)，已經(jīng)引起了各國的重點關(guān)注，但該系統(tǒng)目前尚處于前期研究階段，一些國家正在進行系統(tǒng)的技術(shù)試驗。本研究跟蹤國際海事的前沿技術(shù)，主要對AIS使用的GMSK調(diào)制

2、解調(diào)算法進行研究，在此基礎(chǔ)上對VDES擬使用的正交頻分復(fù)用OFDM(OFDM: Orthogonal Frequency Division Multiplexing)調(diào)制解調(diào)技術(shù)和正交振幅調(diào)制QAM(QAM:Quadrature Amplitude Modulation)調(diào)制解調(diào)技術(shù)分別進行深入研究和性能分析。
　　本文針對QAM調(diào)制解調(diào)方式的關(guān)鍵技術(shù)進行深入的研究，主要包括調(diào)制的基帶成型濾波器設(shè)計與實現(xiàn)、解調(diào)的位同步算法研究與實

3、現(xiàn)和載波同步算法的研究與實現(xiàn)。位同步技術(shù)研究采用QAM解調(diào)位同步的Gardner算法;載波恢復(fù)算法主要研究面向判決(DD)算法、減星座(RC)算法和極性判決算法，并選擇矩形星座圖的減星座(RC)算法進行實現(xiàn)。
　　本研究首先進行功能仿真驗證，然后進行現(xiàn)場可編程門陣列FPGA(FPGA:Field-Programmable Gate Array)實現(xiàn)。利用Xilinx公司的ISE環(huán)境下使用Verilog HDL語言對QAM調(diào)制解調(diào)進

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