降壓型DC_DC開關電源芯片振蕩器設計.pdf_第1頁
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文檔簡介

1、隨著電子技術的飛速發(fā)展,電源被應用于電子通訊和數(shù)碼產(chǎn)品等電子產(chǎn)品中,而體積小、速度快、性能敏捷、高效率成為電源的發(fā)展趨勢;尤其是高度集成化的DC_DC變換器稱為近些年來的研究熱點。相比分離元件的電路,集成電路更易受工作環(huán)境的影響。因此,本文主要是針對電流模式的PWM調(diào)制模式的降壓型DC_DC變換器中的次諧波振蕩引起的開環(huán)不穩(wěn)定以及電磁干擾(EMI)進行研究。
  本文研究了應用于峰值電流型開關電源的斜坡補償技術和擴頻調(diào)制技術,并基

2、于0.5μm BCD工藝,采用cadence設計平臺來實現(xiàn)相關的電路設計。
  首先,在電流模式的PWM調(diào)制模式的降壓型DC_DC變換器中,次諧波振蕩通常會引起系統(tǒng)開環(huán)不穩(wěn)定。本文采用分段式斜坡補償技術來消除這種次諧波振蕩的影響;仿真結果顯示,分段斜坡補償技術具有很好的消除次諧波振蕩效果,不僅消除了次諧波振蕩,而且避免了過補償問題,降低了斜坡補償對帶載能力的影響。
  其次,本文還研究了片內(nèi)振蕩器電路,設計了振蕩頻率為18

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