QPSK調(diào)制解調(diào)器的設(shè)計(jì)及FPGA實(shí)現(xiàn).pdf_第1頁(yè)
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1、QPSK調(diào)制具有頻譜利用率高、傳輸速率快、抗干擾性能強(qiáng)、頻譜特性好等突出特點(diǎn)，在移動(dòng)通信、衛(wèi)星通信中得到了廣泛應(yīng)用。因此，基于FPGA的全數(shù)字QPSK調(diào)制解調(diào)的研究具有重要的意義。
　　 本文介紹了QPSK調(diào)制解調(diào)技術(shù)的現(xiàn)狀，對(duì)QPSK調(diào)制解調(diào)技術(shù)的發(fā)展和硬件平臺(tái)進(jìn)行了詳細(xì)說明。對(duì)QPSK調(diào)制解調(diào)系統(tǒng)的基本原理及系統(tǒng)組成進(jìn)行了分析，主要包括RS編譯碼、卷積碼、維特比譯碼、交織等差錯(cuò)編碼的基本原理，以及QPSK解調(diào)的中頻數(shù)字下變頻

2、、載波同步和位同步。在此基礎(chǔ)上對(duì)QPSK調(diào)制解調(diào)系統(tǒng)的各模塊進(jìn)行了基于MATLAB的仿真，完成了QPSK中頻調(diào)制解調(diào)器各模塊的硬件語(yǔ)言描述、時(shí)序仿真及FPGA實(shí)現(xiàn)；同時(shí)分別給出調(diào)制和解調(diào)系統(tǒng)的的資源消耗費(fèi)。闡述了該系統(tǒng)實(shí)現(xiàn)的硬件平臺(tái)，分析了該系統(tǒng)的性能，同時(shí)對(duì)調(diào)制端的DAC芯片配置進(jìn)行了詳細(xì)的介紹。
　　 其中，本文設(shè)計(jì)的調(diào)制器已成功應(yīng)用于某雷達(dá)系統(tǒng)數(shù)據(jù)傳輸?shù)腝PSK中頻調(diào)制解調(diào)軟件設(shè)計(jì)項(xiàng)目中，符號(hào)速率為8MSPS、中頻頻率為6

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