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文檔簡介
1、首先是針對RSA算法硬件實現(xiàn)部分的軟核設計.在設計的過程中,完成了整體的結(jié)構(gòu)劃分,使用Verilog HDL硬件描述語言進行了電路的RTL級描述,并利用了Candence公司的Verilog-XL完成了軟件平臺上的行為級仿真,實現(xiàn)了1024位數(shù)據(jù)的加密/解密的邏輯功能.RSA算法實現(xiàn)的軟核設計在應用上具有很大的靈活性和獨立性,在接口模塊的配合下可以作為系統(tǒng)中獨立的加密/解密運算部件,在微處理器的控制下使用,可以作為獨立的專用系統(tǒng)來使用.
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