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1、1實(shí)驗(yàn)一實(shí)驗(yàn)一門電路邏輯功能測(cè)試及簡單設(shè)計(jì)門電路邏輯功能測(cè)試及簡單設(shè)計(jì)一、實(shí)驗(yàn)?zāi)康囊?、?shí)驗(yàn)?zāi)康?熟悉數(shù)字萬用表、示波器和數(shù)字電路基礎(chǔ)實(shí)驗(yàn)箱的使用;2掌握TTL和CMOS與門主要參數(shù)的測(cè)試方法;3了解門電路的電壓傳輸特性的測(cè)試方法;4掌握74LS00與非門、74LS02或非門、74LS86異或門、74LS125三態(tài)門和CC4011門電路的邏輯功能;5掌握三態(tài)門的邏輯功能。6掌握利用門電路設(shè)計(jì)數(shù)字電路的方法。二、預(yù)習(xí)要求二、預(yù)習(xí)要求1了解T
2、TL和CMOS與非門主要參數(shù)的定義和意義。2熟悉各測(cè)試電路,了解測(cè)試原理及測(cè)試方法。3熟悉74LS00、74LS02、74LS86、74LS125和CC4011的外引線排列。4畫實(shí)驗(yàn)電路和實(shí)驗(yàn)數(shù)據(jù)表格。三、實(shí)驗(yàn)原理與參考電路三、實(shí)驗(yàn)原理與參考電路1、TTL與非門的主要參數(shù)TTL與非門具有較高的工作速度、較強(qiáng)的抗干擾能力、較大的輸出幅度和負(fù)載能力等優(yōu)點(diǎn)煙而得到了廣泛的應(yīng)用。(1)輸出高電平:輸出高電平是指與非門有一個(gè)以上輸入端接地或接低電
3、平時(shí)的輸出電平值。OHV空載時(shí),必須大于標(biāo)準(zhǔn)高電平(),接有拉電流負(fù)載時(shí),將下降。測(cè)試的電OHVVVSH4.2?OHVOHV路如圖1.1所示。(2)輸出低電平:輸出低電平是指與非門的所有輸入端都接高電平時(shí)的輸出電平值。空載OLV時(shí),必須低于標(biāo)準(zhǔn)電平(),接有灌電流負(fù)載時(shí),將上升。測(cè)試的電路如圖OLVVVSL4.0?OLVOLV1.2所示。3開路時(shí)的輸出低電平。通常VOL≈0V。和的測(cè)試電路如圖1.5所示。輸入端全部接高電平時(shí)測(cè);將其中任
4、一輸入端接地,其OHVOLVOLV余輸入端接高電平時(shí)測(cè)。OHV本實(shí)驗(yàn)選用的TTL與非門為74LS00,選用的CMOS與非門為CC4011。它們的外引線排列如圖1.6和圖1.7所示。3、三態(tài)門邏輯門的輸出有高、低電平、高阻三種狀態(tài)的門電路。(1)三態(tài)門種類按邏輯功能分:三態(tài)與非門、三態(tài)緩沖門、三態(tài)非門、三態(tài)與門。按控制模式分:低電平有效的三態(tài)門和高電平有效的三態(tài)門。(2)三態(tài)門邏輯符號(hào)本實(shí)驗(yàn)選用的74LS125,外引線排列如圖1.8所示。
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