數(shù)字陀螺中數(shù)字信號(hào)處理電路設(shè)計(jì).pdf_第1頁(yè)
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1、目前，微機(jī)械陀螺電路的數(shù)字化集成技術(shù)已經(jīng)成為世界各國(guó)研究的熱點(diǎn)問(wèn)題之一。采用數(shù)字化技術(shù)設(shè)計(jì)微機(jī)械陀螺的接口電路具有如下優(yōu)點(diǎn)：抗干擾能力強(qiáng)、精確度高、不易失真和可靠性高等。因此，本文立足于微機(jī)械陀螺驅(qū)動(dòng)模態(tài)和檢測(cè)模態(tài)的工作原理及相頻特性的基礎(chǔ)上，進(jìn)行接口電路中的數(shù)字信號(hào)處理方向的設(shè)計(jì)。
　　本文電路設(shè)計(jì)部分主要包括三大模塊，分別為信號(hào)發(fā)生模塊、數(shù)據(jù)處理模塊和信號(hào)轉(zhuǎn)換模塊。其中信號(hào)發(fā)生模塊采用DDS技術(shù)生成正、余弦信號(hào)；數(shù)據(jù)處理模塊采

2、用FFT技術(shù)進(jìn)行數(shù)據(jù)采集和計(jì)算，出于對(duì)邏輯資源使用量和數(shù)據(jù)處理速度的考慮，選用基2時(shí)間抽取FFT算法；信號(hào)轉(zhuǎn)換電路選用AD5546、AD7666、LM358等芯片完成。
　　借助Matlab軟件搭建系統(tǒng)的算法模型，確定性能指標(biāo)為：輸入頻率為1MHz，采樣頻率為100KHz，F(xiàn)FT算法的采樣深度為214。采用ISE13.3軟件進(jìn)行IP核配置和編寫Verilog代碼完成各個(gè)模塊的設(shè)計(jì)，并利用Modelsim軟件和ISE13.3軟件聯(lián)合

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