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文檔簡介
1、過去的一些年,摩爾定律已經(jīng)得到了印證,與此同時(shí),數(shù)字電路性能的提升速度要超過模擬混合信號電路,而由此導(dǎo)致的差距,也就此成為在模擬混合信號電路設(shè)計(jì)中引入數(shù)字輔助設(shè)計(jì)技術(shù)的研究動(dòng)力。
流水線ADC中校準(zhǔn)算法的核心是如何估計(jì)和提取誤差。本文首先在流水線ADC架構(gòu)的基礎(chǔ)上分析了等效級間增益誤差產(chǎn)生的主要原因,包括電容失配和運(yùn)放的有限直流增益;進(jìn)一步研究了基于ADSC調(diào)制的后臺相關(guān)校準(zhǔn)算法;針對基本結(jié)構(gòu)校準(zhǔn)算法收斂速度緩慢的問題,利用劈
2、分ADC(SplitADC)結(jié)構(gòu)的相關(guān)校準(zhǔn)算法進(jìn)行校準(zhǔn),最終完成了存在于劈分ADC結(jié)構(gòu)中的第二級級間增益誤差和存在于首級的三階非線性誤差項(xiàng)的全數(shù)字后臺自適應(yīng)校準(zhǔn)。
文中利用C語言建立的設(shè)計(jì)和仿真平臺驗(yàn)證了劈分ADC結(jié)構(gòu)校準(zhǔn)算法的有效性。仿真結(jié)果表明:與未采用校準(zhǔn)算法的流水線ADC相比,采用劈分ADC結(jié)構(gòu)的相關(guān)校準(zhǔn)算法能夠?qū)DC的有效位數(shù)從10.58bit提高到13.94bit,SFDR從82.22dB提高到107.24dB,
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