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1、在微處理器中,可重構(gòu)單元被認(rèn)為是可編程的具有高速計(jì)算能力的硬件結(jié)構(gòu),可重構(gòu)架構(gòu)也因其具有的高性能低功耗性而在并行計(jì)算中顯示了顯著優(yōu)勢(shì)。通常,可重構(gòu)處理器分為細(xì)粒度和粗粒度兩種,多數(shù)研究都致力于在兩者之間取得靈活性和性能的平衡。本研究著眼于性能較高的粗粒度可重構(gòu)處理器,旨在通過(guò)探討可重構(gòu)架構(gòu)中基本單元的設(shè)計(jì)和選擇,以及單元之間的結(jié)合和互連方式,提出一個(gè)可行的、高性能、低功耗、靈活度高的粗粒度可重構(gòu)處理器的硬件模型。同時(shí),針對(duì)該處理器模型,
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