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1、現(xiàn)代雷達(dá)是以信號(hào)處理為核心,由多個(gè)分系統(tǒng)組成的復(fù)雜的系統(tǒng)。為了確保各子系統(tǒng)能夠協(xié)調(diào)地工作,必須設(shè)計(jì)一個(gè)能夠提供精確時(shí)序信號(hào)和實(shí)現(xiàn)多接口通信的功能模塊,即雷達(dá)定時(shí)接口模塊。隨著雷達(dá)相關(guān)理論與技術(shù)的高速發(fā)展,雷達(dá)系統(tǒng)對(duì)定時(shí)接口模塊的多功能、實(shí)時(shí)性和穩(wěn)定性提出了更高的要求?，F(xiàn)場(chǎng)可編程門陣列(FPGA)和高性能DSP處理器的發(fā)展使定時(shí)接口模塊的通用化和模塊化成為了可能。
本文以Xilinx FPGA為主控制器,以ADSP TS201為
2、協(xié)處理器,設(shè)計(jì)一款基于SOPC的通用定時(shí)接口控制系統(tǒng)。論文主要從方案設(shè)計(jì)、硬件平臺(tái)實(shí)現(xiàn)、可編程片上系統(tǒng)(SOPC)設(shè)計(jì)和FPGA邏輯設(shè)計(jì)等方面詳細(xì)地闡述了定時(shí)和接口的設(shè)計(jì)與實(shí)現(xiàn)。文章采用了基于MicroBlaze的硬件和軟件設(shè)計(jì)技術(shù),在軟核內(nèi)實(shí)現(xiàn)控制字的接收與解析以及系統(tǒng)工作模式的控制。通過(guò)邏輯設(shè)計(jì)完成了時(shí)序信號(hào)的產(chǎn)生與控制以及FPGA和DSP之間的通信接口設(shè)計(jì)。采用FPGA內(nèi)部集成的MAC IP核實(shí)現(xiàn)了基于UDP協(xié)議的以太網(wǎng)接口模塊設(shè)
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