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1、高時(shí)效性是SAR成像系統(tǒng)的一個(gè)關(guān)鍵性能,SAR成像處理數(shù)據(jù)量大,運(yùn)算量大,要實(shí)現(xiàn)實(shí)時(shí)處理就要求運(yùn)算速度極快.SAR成像運(yùn)算量主要集中在距離向和方位向的壓縮處理上,常用的壓縮處理方案是采用高速DSP實(shí)現(xiàn),這種方法曾被認(rèn)為是SAR實(shí)時(shí)處理最佳的硬件實(shí)現(xiàn)方案,但是近幾年可編程器件的發(fā)展使得FPGA已經(jīng)成為比DSP更優(yōu)越的壓縮處理方式,體積、速度、靈活性等各種性能都全面優(yōu)于DSP.該文的主要內(nèi)容可歸納為以下幾個(gè)方面:1.項(xiàng)目要求,在討論了系統(tǒng)指
2、標(biāo)基礎(chǔ)上,選定了ALTERA公司的STRATIX系列FPGA芯片EP1S25F672C7來(lái)實(shí)現(xiàn)實(shí)時(shí)處理的核心算法.2.負(fù)責(zé)整個(gè)系統(tǒng)FPGA部分的工作,完成了距離壓縮和方位壓縮的FPGA軟件編程、硬件調(diào)試,采用實(shí)際星載SAR原始數(shù)據(jù)對(duì)整個(gè)系統(tǒng)進(jìn)行了測(cè)試,達(dá)到了項(xiàng)目要求.3.制定并協(xié)調(diào)了系統(tǒng)板間的通信協(xié)議,保證數(shù)據(jù)傳輸?shù)姆€(wěn)定可靠.4.對(duì)采用更高檔FPGA實(shí)現(xiàn)更高性能更多數(shù)據(jù)的SAR實(shí)時(shí)處理系統(tǒng)進(jìn)行了探討,為將來(lái)的研究工作打下了基礎(chǔ).該課題基
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