面向IMT-A應用的可變增益放大器(PGA)設計與實現(xiàn).pdf_第1頁
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文檔簡介

1、在無線通信系統(tǒng)中，傳輸速率越來越大，調(diào)制方式越來越復雜，要求越來越長的持續(xù)通訊時間、以及越來越高的系統(tǒng)靈敏度，由此，作為收發(fā)機芯片主要模塊之一的可變增益放大器，系統(tǒng)對其提出的帶寬、線性度、功耗和噪聲等性能指標也越來越苛刻；而且，采用深亞微米CMOS技術之后，低電源電壓使得可變增益放大器在這些指標的折衷問題上面臨著諸多挑戰(zhàn)。
　　 本文基于Cadence EDA平臺，采用TSMC的0.18μm工藝設計并實現(xiàn)了面向IMT-A應用的可

2、編程增益放大器（programmable gain amplifier, PGA）；為了應用于零中頻架構的接收機中，本文還設計實現(xiàn)了直流失調(diào)消除電路(DCOC);為了減小靜態(tài)功耗，本文在設計了普通源隨器測試buffer的基礎上，另外又設計了AB類輸出buffer，使整體電路（不含測試buffer）最大靜態(tài)直流為17mA，與源極跟隨器相比，該電路在實現(xiàn)相同功能的情況下，靜態(tài)直流小了7mA，且對有用信號的衰減較?。徽w芯片面積（包括所有PA

3、D）為800*700um2。
　　 根據(jù)測試結果，工作電壓1.8V，在負載為差分100Ω阻抗的情況下，整體電路增益動態(tài)范圍可達63dB，采用二進制控制，增益步長為1dB，步長誤差在±0.38dB以內(nèi)；在測試buffer存在約為6dB衰減的情況下，整體電路的最高增益為55dB，-3dB帶寬為92MHz，在低增益模式下IIP3可達17.5dBm，1dB壓縮點可達5.7dBm;根據(jù)仿真結果，高增益模式下在10MHz處輸入?yún)⒖荚肼?IR

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