2023年全國(guó)碩士研究生考試考研英語(yǔ)一試題真題（含答案詳解+作文范文）_第1頁(yè)
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1、本文主要研究集成功率轉(zhuǎn)換器電路及其高層次行為模型描述。作者設(shè)計(jì)了兩種DC/DC功率轉(zhuǎn)換器——PFM升壓型DC/DC和PWM降壓型DC/DC——的電路結(jié)構(gòu)及其Verilog-A行為模型。分別基于BSIM3V3Spice模型和Sim-BCD2μm/36V雙極工藝，采用CadenceSpectre對(duì)其內(nèi)部電路進(jìn)行了系統(tǒng)仿真。這兩種DC/DC轉(zhuǎn)換器電路結(jié)構(gòu)簡(jiǎn)單，版圖面積小，具有低功耗、高精度的特點(diǎn)。同時(shí)，分析了模擬硬件描述語(yǔ)言Verilog-A

2、的特點(diǎn)，介紹了利用Verilog-A語(yǔ)言描述的模塊進(jìn)行系統(tǒng)仿真的過(guò)程。本文以DC/DC轉(zhuǎn)換器的控制電路模塊——PFM和PWM的設(shè)計(jì)為例，介紹了用基于模擬硬件描述語(yǔ)言Verilog-A的行為模型進(jìn)行系統(tǒng)設(shè)計(jì)的新方法。利用CadenceSpectre仿真器對(duì)該模型進(jìn)行了功能驗(yàn)證和系統(tǒng)級(jí)仿真。比較兩種仿真結(jié)果后，可以得出結(jié)論：使用Verilog-A語(yǔ)言對(duì)模擬部分進(jìn)行行為級(jí)建模在很大程度上減少仿真的時(shí)間，加快設(shè)計(jì)進(jìn)程，并且提高仿真精度。仿真結(jié)果

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