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文檔簡介
1、該文提出一種32x32位的乘法器設(shè)計方案.該乘法器采用了改進(jìn)的Booth算法減少部分積的個數(shù);使用同一套電路處理無符號數(shù)乘法和有符號數(shù)乘法,并且簡化了部分積的符號擴(kuò)展.在部分積的累加方面,使用4-2計數(shù)器實現(xiàn)Wallace樹,避免了使用普通3-2加法器造成的布線復(fù)雜度,并且利用加法器輸入端口到輸出端口不同路徑的延時不同的特性,提高了部分積的歸約性能.為了提高時鐘步率,該乘法器應(yīng)用了流水線技術(shù)把乘法過程分解到2個周期內(nèi)完成.該乘法器具有完
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