雷達信號處理常用模塊的IP核設(shè)計.pdf_第1頁
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文檔簡介

1、IP核的可重用性、可靠性與穩(wěn)定性使其在集成電路設(shè)計領(lǐng)域的應(yīng)用越來越廣泛，將IP核技術(shù)應(yīng)用到雷達信號處理領(lǐng)域有著更深遠的意義。
　　 本文首先調(diào)查研究了關(guān)于IP核設(shè)計的一些標準與規(guī)范，其中VSIA最具有代表性。其次，針對IP核基于標準評測及基于EDA工具評測等關(guān)鍵性內(nèi)容進行了探討與比較。在重點的學(xué)習(xí)和理解Xilinx FPGA綜合、翻譯、映射、布局布線等設(shè)計流程的基礎(chǔ)上，給出了基于VHDL語言的IP軟核設(shè)計標準的簡單嘗試，包括IP

2、核開發(fā)文檔的管理、IP核驗證、IP核封裝及集成等方面。
　　 基于以上準則與規(guī)范，對數(shù)字下變頻、脈沖壓縮、動目標顯示及自相關(guān)矩陣等雷達信號處理常用模塊進行了IP核設(shè)計，包括原理簡介、設(shè)計過程、理論驗證、實現(xiàn)分析等四部分。實現(xiàn)過程主要采用Xilinx Virtex-6系列芯片的強大硬核運算處理單元DSP48E，充分利用其級聯(lián)特性組成高速、穩(wěn)定的數(shù)據(jù)處理鏈。
　　 最后研究了Xilinx綜合技術(shù)XST，包括XST的HDL語言

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