雷達(dá)高度表高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn).pdf_第1頁(yè)
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文檔簡(jiǎn)介

1、本文介紹了一種基于Compact PCI 總線的高速數(shù)據(jù)采集系統(tǒng)，該系統(tǒng)用于脈沖雷達(dá)高度表視頻回波信號(hào)的實(shí)時(shí)采集，也可以用于其他通用的數(shù)據(jù)采集場(chǎng)合；系統(tǒng)采樣率高達(dá)200MSPS，量化精度12bit，并且實(shí)現(xiàn)了小于0.3％的模擬信號(hào)靜態(tài)失真度。
　　 目前，高性能數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)和實(shí)現(xiàn)的難點(diǎn)并不在于信號(hào)的高速采樣，而是在于數(shù)據(jù)的實(shí)時(shí)處理、傳輸和存儲(chǔ)；傳統(tǒng)的存儲(chǔ)介質(zhì)往往具有速度或者容量方面的不足，而數(shù)據(jù)向計(jì)算機(jī)系統(tǒng)的傳輸也往往會(huì)受到

2、總線速度、操作系統(tǒng)響應(yīng)延遲等因素的影響，這些都成為限制數(shù)據(jù)采集系統(tǒng)性能提高的瓶頸。
　　 經(jīng)過大量的分析與論證工作，本課題決定采用高性能FPGA 實(shí)現(xiàn)數(shù)據(jù)的實(shí)時(shí)處理，并根據(jù)系統(tǒng)的各項(xiàng)參數(shù)設(shè)計(jì)和實(shí)現(xiàn)了多級(jí)數(shù)據(jù)緩存系統(tǒng)，實(shí)現(xiàn)了ADC 采樣數(shù)據(jù)與Compact PCI 總線之間的適配，然后用32bit/33MHz 配置的Compact PCI 總線和RAID 0組態(tài)的磁盤陣列來(lái)實(shí)現(xiàn)數(shù)據(jù)的高速傳輸和存儲(chǔ)。
　　 本文首先對(duì)數(shù)據(jù)采

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