10bits 100 MSPS Pipelined ADC的采保和時鐘電路研究與設計.pdf_第1頁
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文檔簡介

1、基于通信系統(tǒng)對高速高精度模數(shù)轉(zhuǎn)換器的應用需求及采保電路在ADC中的重要作用,本文主要的研究方向是:進行1.5位每級流水線ADC系統(tǒng)級仿真,設計1.5位每級10位100MSPS流水線ADC的典型單元采保電路和時鐘電路.首先,利用Matlab進行ADC系統(tǒng)級仿真.驗證失調(diào)電壓、運放增益誤差對級轉(zhuǎn)換電路的輸出范圍的影響;證明子DAC基準偏差導致流水線ADC出現(xiàn)失級和失碼,指導電路級設計進行電容匹配來減小子DAC基準偏差.其次,在Cadence

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