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1、該文以三次群光接收機(jī)的研制為背景,研究了數(shù)字分接技術(shù)的FPGA實(shí)現(xiàn)技術(shù),設(shè)計(jì)實(shí)現(xiàn)了完整的三次群光接收機(jī),線路碼速率達(dá)67.584Mbit/s.文中首先對數(shù)字復(fù)接技術(shù)中的同步復(fù)接和異步復(fù)接進(jìn)行了較系統(tǒng)的介紹,對其實(shí)現(xiàn)方法進(jìn)行了詳細(xì)的闡述.在此基礎(chǔ)之上實(shí)現(xiàn)了準(zhǔn)同步復(fù)接的二次群分接器和三次群光端機(jī)的信號處理中的同步分接部分.其次,詳細(xì)討論了全數(shù)字鎖相環(huán)的實(shí)現(xiàn)方法,給出了具體的實(shí)現(xiàn)模擬波形.針對該課題中用到的時(shí)鐘提取,分析并提出了用于低速時(shí)鐘提
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