12位時間交織流水線ADC的設計及通道失配研究.pdf_第1頁
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文檔簡介

1、高性能的模數(shù)轉(zhuǎn)換器越來越多的應用在國防、通信和高端家電等領域，是電子信息產(chǎn)業(yè)中的一項關鍵技術。隨著電子信息領域的發(fā)展，各種通信設備的工作速度不斷提高，因此對于高速模數(shù)轉(zhuǎn)換器的需求日趨迫切。傳統(tǒng)結(jié)構的ADC在保證精度的情況下，速度實現(xiàn)幾乎達到了極限。因此，將單通道的ADC并行化是突破轉(zhuǎn)換速率的限制并不犧牲精度的有效方法。多通道時間交織技術存在著固有的弊端，即通道間的增益失配、失調(diào)失配和采樣時刻失配會降低系統(tǒng)精度，需要校正技術消除誤差。

2、r>　　本文首先基于CMOS Smic0.18μm工藝設計了一款12位50MHz的單通道流水線ADC，在輸入561.523kHz的正弦信號時，信噪失真比（SNDR）達到70.3581dB，動態(tài)無雜散范圍（SFDR）為77.9108dB，有效位數(shù)（ENOB）為11.5137位。在此基礎上，詳細分析了雙通道時間交織流水線ADC的失配產(chǎn)生原因，通過數(shù)學推導將失調(diào)失配、增益失配和采樣時刻失配對系統(tǒng)精度的影響進行量化，并利用Matlab建模仿真驗

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