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1、NVIDIA公司設(shè)計(jì)的基于GPGPU的通用并行計(jì)算架構(gòu)CUDA已經(jīng)在各個(gè)領(lǐng)域得到廣泛的應(yīng)用。本文針對(duì)GPGPU設(shè)備外部的并行設(shè)計(jì)了基于CUDA的簡(jiǎn)化并行編程方案。首先,本文針對(duì)大批量數(shù)據(jù)場(chǎng)景提出了GPGPU設(shè)備間并行編程簡(jiǎn)化方案,以輔助本文提出的多地址空間封裝技術(shù)能夠獨(dú)立地運(yùn)行于集群環(huán)境中。此外,本文提出的GPGPU設(shè)備間并行編程解決方案引入了數(shù)據(jù)復(fù)用技術(shù),對(duì)視頻處理任務(wù)場(chǎng)景提供了優(yōu)化。其次,本文針對(duì)CUDA并行編程中內(nèi)存管理與多地址空
2、間架構(gòu)具有較高耦合度這一問(wèn)題,提出了多地址空間封裝技術(shù)來(lái)簡(jiǎn)化CPU與GPGPU設(shè)備間的并行編程。
基于多地址空間封裝技術(shù),本文提出了源碼轉(zhuǎn)換技術(shù),以進(jìn)一步簡(jiǎn)化CUDA編程中的內(nèi)存管理,允許編程者對(duì)于內(nèi)存相關(guān)變量采取只聲明不維護(hù)的編碼方式。在實(shí)驗(yàn)中,本文將多地址空間封裝技術(shù)與CUDA的統(tǒng)一虛擬尋址技術(shù)進(jìn)行了對(duì)比,實(shí)驗(yàn)結(jié)果表明:當(dāng)計(jì)算所需數(shù)據(jù)位于其它設(shè)備中時(shí),在執(zhí)行訪存密集型任務(wù)時(shí),多地址空間封裝技術(shù)占有性能優(yōu)勢(shì);在執(zhí)行計(jì)算密集型
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