基于多核DSP的雷達信號處理板研制.pdf_第1頁
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文檔簡介

1、性能優(yōu)良的雷達信號處理機需要高速的數(shù)據(jù)采集能力、強大的嵌入式計算能力和數(shù)據(jù)傳輸能力。因此，本文設(shè)計的雷達信號處理板采用具有8000MIPS運算能力的高性能8核處理器TMS320C6678 DSP用于信號處理運算，運用高速傳輸標準SRIO用于數(shù)據(jù)傳輸；此外，系統(tǒng)采用具有500MSPS的12位高速AD用于雷達數(shù)據(jù)采集和轉(zhuǎn)換。
　　本次設(shè)計的雷達信號處理板以DSP+FPGA架構(gòu)為基礎(chǔ)，采用德州儀器新近推出的多核DSP旗艦產(chǎn)品TMS320

2、C6678作為本處理板的核心計算單元。同時，采用賽靈思公司的高速FPGA XC6VLX75T作為本系統(tǒng)的協(xié)處理器單元。TMS320C6678集成了8個核心處理器，單核工作頻率最大可以達到1.25GHz。XC6VLX75T擁有GTX模塊，該模塊可以通過IP核配置為SRIO、PCIE等多種接口標準。本處理板采用SRIO接口作為C6678和XC6VLX75T之間數(shù)據(jù)通信的傳輸標準，用于傳輸1Gbit/S的實際數(shù)據(jù)。
　　處理板采用芯片引

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