基于FPGA的數(shù)字下變頻與數(shù)字脈沖壓縮技術(shù)研究.pdf_第1頁
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文檔簡介

1、數(shù)字下變頻與數(shù)字脈沖壓縮技術(shù)被廣泛的應(yīng)用于脈沖雷達(dá)接收機(jī)中。數(shù)字下變頻將采樣后的信號去載頻化，使得信號可以在零中頻進(jìn)行處理。而數(shù)字脈沖壓縮作為雷達(dá)算法中的一項(xiàng)重要技術(shù)，解決了雷達(dá)距離分辨力與發(fā)射距離之間的矛盾。隨著大規(guī)模集成電路的不斷更新進(jìn)步，雷達(dá)接收機(jī)中的信號處理算法越來越多的從DSP（Digital Signal Processor）前移至FPGA（Field Programmable Gate Array）。研究基于FPGA的數(shù)字

2、下變頻與數(shù)字脈沖壓縮實(shí)現(xiàn)不僅是雷達(dá)數(shù)字化的重要內(nèi)容，更使得信號處理的速度得到大幅度的提高并釋放了DSP的寶貴資源。
　　本文首先研究了構(gòu)成數(shù)字下變頻系統(tǒng)的各個(gè)模塊單元，主要包括：帶通采樣定理；混頻器NCO；CIC抽取濾波器；FIR濾波器。然后又研究了搭建數(shù)字脈沖壓縮系統(tǒng)所需的理論知識，包括：匹配濾波器；時(shí)間帶寬乘積及線性調(diào)頻信號的脈沖壓縮。隨后分析了實(shí)現(xiàn)數(shù)字下變頻各個(gè)單元所采用的算法、結(jié)構(gòu)并加以對比。對脈沖壓縮的方案進(jìn)行選擇，重點(diǎn)

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