高速時(shí)鐘數(shù)據(jù)恢復(fù)系統(tǒng)的研究.pdf_第1頁
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文檔簡介

1、隨著傳輸數(shù)據(jù)速率不斷提高,高速串行收發(fā)器得到了越來越多的應(yīng)用。在串行收發(fā)器中,時(shí)鐘數(shù)據(jù)恢復(fù)系統(tǒng)是它的核心電路。本文采用了基于半數(shù)字雙環(huán)路的時(shí)鐘數(shù)據(jù)恢復(fù)系統(tǒng),并對它進(jìn)行了理論分析和芯片驗(yàn)證。在本文中,我們詳細(xì)討論一階和二階時(shí)鐘數(shù)據(jù)恢復(fù)系統(tǒng)的特性,并用二個(gè)芯片來驗(yàn)證時(shí)鐘數(shù)據(jù)恢復(fù)系統(tǒng)的理論分析。其中一個(gè)芯片使用了一階時(shí)鐘數(shù)據(jù)恢復(fù)系統(tǒng),滿足4.8Gb/s的串行傳輸速率要求。另外一個(gè)芯片使用了二階時(shí)鐘數(shù)據(jù)恢復(fù)系統(tǒng),滿足6Gb/s的傳輸速率要求。這

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