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文檔簡介
1、本論文屬于DisplayPort數(shù)字視頻傳輸接口解決方案的CMOS集成電路設(shè)計環(huán)節(jié)中的物理層邏輯部分，即整個系統(tǒng)的物理層數(shù)字集成電路設(shè)計部分。
本論文闡述了DisplayPort數(shù)字視頻傳輸原理，分析了數(shù)字電路系統(tǒng)架構(gòu)，并對物理層數(shù)字電路實現(xiàn)進行深入研究，提出綜合解決方案，結(jié)合先進的EDA工具，完成此方案的CMOS數(shù)字集成電路設(shè)計，最后對該電路的性能進行測試和驗證，結(jié)果表明該電路達到預(yù)期要求。取得的主要成果包括：
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2、.對主鏈路及輔助通道的物理層邏輯電路架構(gòu)進行詳細設(shè)計，為國內(nèi)研究人員和數(shù)字電路設(shè)計工作者進行DisplayPort V1.2設(shè)計奠定良好的基礎(chǔ)。
2.采用動態(tài)時鐘管理技術(shù)對DisplayPort接口系統(tǒng)進行控制，能有效降低DisplayPort接口集成電路中邏輯子塊的功耗約32％，提高了邏輯電路效率。
3.設(shè)計出符合DisplayPort V1.2傳輸?shù)母咚俅衅骷敖獯鳎瑔瓮ǖ拦ぷ黝l率為2.7GHz，數(shù)據(jù)傳輸率為每
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