基于MCS-51指令集的CPU硬核設(shè)計.pdf_第1頁
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文檔簡介

1、隨著設(shè)計與制造技術(shù)的發(fā)展，集成電路設(shè)計從晶體管的集成邏輯到邏輯門的集成，現(xiàn)在發(fā)展到IP的集成，即SOC(System-on-a-Chip)設(shè)計技術(shù)。SOC可以有效的降低電子產(chǎn)品的開發(fā)成本，縮短開發(fā)周期，提高產(chǎn)品的競爭力，是今后業(yè)界最主要的產(chǎn)品開發(fā)方式。
　　 CPU的設(shè)計涵蓋了SOC設(shè)計中的核心技術(shù)，是一個通過設(shè)計復用達到高生產(chǎn)率的硬件一軟件協(xié)同設(shè)計的過程，包含了IP核可復用設(shè)計/測試方法及接口規(guī)范、系統(tǒng)芯片總線集成設(shè)計方法、系

2、統(tǒng)芯片驗證和測試方法。MCS-51指令集作為一款CISC指令集，以其譯碼邏輯硬件資源簡單，性能穩(wěn)定，和軟件資源豐富等優(yōu)勢，在工控領(lǐng)域得到廣泛應(yīng)用。
　　 本文從指令集、系統(tǒng)級設(shè)計、RTL級驗證、邏輯綜合及版圖設(shè)計等幾個方面對CPU設(shè)計進行了深入的分析。最終，在IBM0.18μmCMOS工藝下，設(shè)計出一款時鐘頻率在100MHZ，完全涵蓋MCS-51指令集的8位CPU。
　　 本文主要的研究內(nèi)容包括如下幾點：
　　

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