高性能CPU存儲(chǔ)層次的分析與實(shí)現(xiàn).pdf_第1頁
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文檔簡(jiǎn)介

1、本文首先分析了緩存性能對(duì)CPU整體性能的影響,然后討論了CPU存儲(chǔ)層次中緩存的體系結(jié)構(gòu),在已完成的32位全定制CPU緩存的基礎(chǔ)上,利用高級(jí)語言建立不同結(jié)構(gòu)的緩存模型,通過仿真、統(tǒng)計(jì)和比較選取合適的緩存結(jié)構(gòu),實(shí)現(xiàn)并驗(yàn)證了RTL級(jí)高性能緩存控制器,設(shè)計(jì)實(shí)現(xiàn)了哈佛雙總線結(jié)構(gòu)帶寫緩沖的緩存,分離的16KB的指令緩存及16KB的數(shù)據(jù)緩存,采用二路組相聯(lián)的映射規(guī)則,虛擬地址索引、物理地址與TAG比較判斷是否命中,采用了LRU替換策略,并用FIFO實(shí)

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