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1、該論文從SOC設(shè)計(jì)的角度出發(fā),設(shè)計(jì)實(shí)現(xiàn)了JPEG CODEC和靜止圖像處理器,并且成功集成在140成像素的數(shù)碼相機(jī)芯片中.JPEG CODEC的系統(tǒng)集成設(shè)計(jì)實(shí)現(xiàn)了一個(gè)壓縮和解壓縮流程硬件共享的流水線結(jié)構(gòu),建立了良好的數(shù)據(jù)傳輸和反饋機(jī)制,并且合理規(guī)劃了數(shù)據(jù)緩沖區(qū),同時(shí)在設(shè)計(jì)中部分采用容錯(cuò)設(shè)計(jì),提高了系統(tǒng)可靠性.該論文同時(shí)提出了一種新穎的二維DCT/IDCT的硬件實(shí)現(xiàn).設(shè)計(jì)在正向和逆向變換過程中對(duì)主要的算術(shù)運(yùn)算單元采用硬件復(fù)用的方法,達(dá)到了
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