基于FPGA的信道均衡器的設(shè)計與實現(xiàn).pdf_第1頁
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文檔簡介

1、在無線通信系統(tǒng)中,信號在傳輸過程中由于多徑效應(yīng)和信道帶寬的有限性以及信道特性的不完善性導(dǎo)致不可避免地產(chǎn)生碼間串?dāng)_(Intersymbol Interference).為了克服碼間串?dāng)_所帶來的信號畸變,則必須在接收端增加均衡器,以補償信道特性,正確恢復(fù)發(fā)送序列.盲均衡器由于不需要訓(xùn)練序列,僅利用接收信號的統(tǒng)計特性就能對信道特性進行均衡,消除碼間串?dāng)_,成為近年來通信領(lǐng)域研究的熱點課題.本課題采用已經(jīng)取得了很多研究成果的Bussgang類盲均

2、衡算法,主要因為它的計算復(fù)雜度小,便于實時實現(xiàn),具有較好的性能.本文探討了以FPGA(Field Programmable Gates Array)為平臺,使用Verilog HDL(Hardware Description Language)語言設(shè)計并實現(xiàn)基于Bussgang類型算法的盲均衡器的硬件系統(tǒng).本文簡要介紹了Bussgang類型盲均衡算法中的判決引導(dǎo)LMS(DDLMS)和常模(CMA)兩種算法和FPGA設(shè)計流程.并詳細(xì)闡述了

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