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1、本設(shè)計(jì)利用直接數(shù)字合成技術(shù)(DDS)和延時(shí)疊加來產(chǎn)生干擾信號(hào)，本設(shè)計(jì)由兩片F(xiàn)PGA實(shí)現(xiàn)，一片完成DDS和延時(shí)疊加的功能，另一片完成測試和控制的功能。對(duì)干擾信號(hào)產(chǎn)生電路的原理、軟件設(shè)計(jì)實(shí)現(xiàn)、硬件設(shè)計(jì)實(shí)現(xiàn)進(jìn)行研究，并給出了該設(shè)計(jì)的部分測試結(jié)果。 首先介紹了系統(tǒng)設(shè)計(jì)的思想，F(xiàn)PGA 的基本結(jié)構(gòu)和設(shè)計(jì)流程，電源設(shè)計(jì)，說明了各芯片的特點(diǎn)和作用，JTAG接口等；接著介紹了干擾信號(hào)產(chǎn)生電路的DDS設(shè)計(jì)的原理，實(shí)現(xiàn)和仿真測試結(jié)果及MATLAB的
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