基于閃存陣列的數(shù)據(jù)匯集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn).pdf_第1頁
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文檔簡介

1、隨著數(shù)字化、網(wǎng)絡(luò)化以及大數(shù)據(jù)的推廣,存儲測試也朝著大容量、多通道、多接口形式以及分布式的方向發(fā)展。為此本課題設(shè)計(jì)了基于閃存陣列的數(shù)據(jù)匯集系統(tǒng),并提出系統(tǒng)設(shè)計(jì)方案。系統(tǒng)包含兩部分,分別是負(fù)責(zé)存儲的NAND FLASH陣列和對多路數(shù)據(jù)進(jìn)行接收、編幀和發(fā)送的系統(tǒng)。
　　NAND FLASH陣列的規(guī)模為4×4,采用位擴(kuò)展技術(shù)進(jìn)行構(gòu)建;采用DMA技術(shù)和分時加載的方式可以將其存儲速度提高到64MB/S,同時針對 FLASH的無效塊管理問題,選

2、擇了控制邏輯易實(shí)現(xiàn)的全相關(guān)的管理方法。在此基礎(chǔ)之上,介紹了采用SOPC技術(shù)實(shí)現(xiàn)的存儲陣列的內(nèi)部框圖以及對系統(tǒng)的控制的軟件流程圖。
　　數(shù)據(jù)匯集系統(tǒng)則主要由數(shù)據(jù)接收模塊,數(shù)據(jù)緩存 FIFO,FIFO讀寫控制單元,編幀單元,長線傳輸單元組成。數(shù)據(jù)接收模塊完成多通道、多接口形式數(shù)據(jù)的接收,在FIFO讀寫控制單元的控制下,FIFO將數(shù)據(jù)進(jìn)行緩存;編幀單元則是將緩存的數(shù)據(jù)有序地、準(zhǔn)確地取出,并對這些數(shù)據(jù)進(jìn)行編幀處理,提高數(shù)據(jù)接收的可靠性;編

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