專用集成電路設(shè)計(jì)方法研究與應(yīng)用——高速浮點(diǎn)乘法器設(shè)計(jì).pdf_第1頁
已閱讀1頁，還剩71頁未讀， 繼續(xù)免費(fèi)閱讀

下載本文檔

版權(quán)說明：本文檔由用戶提供并上傳，收益歸屬內(nèi)容提供方，若內(nèi)容存在侵權(quán)，請(qǐng)進(jìn)行舉報(bào)或認(rèn)領(lǐng)

文檔簡(jiǎn)介

1、本文主要研究基于F206DSP的40/32位浮點(diǎn)/整數(shù)乘法器設(shè)計(jì)。內(nèi)容包括乘法的補(bǔ)碼算法，乘法器的陣列選擇，進(jìn)位選擇加法電路的實(shí)現(xiàn)以及該乘法器的CMOS邏輯電路設(shè)計(jì)，并在實(shí)現(xiàn)其硬件邏輯的基礎(chǔ)上完成總體仿真。 文章首先討論了DSP的數(shù)據(jù)格式以及浮點(diǎn)數(shù)的基本操作，重點(diǎn)說明了浮點(diǎn)乘法器的流程。針對(duì)補(bǔ)碼形式的數(shù)據(jù)格式，在比較了幾種補(bǔ)碼算法的基礎(chǔ)上，選擇了改進(jìn)的Booth算法進(jìn)行深入討論并將其應(yīng)用于到乘法器的設(shè)計(jì)中去。 然后詳細(xì)分

2、析了乘法器的陣列選擇，討論了陣列乘法器的兩種典型陣列：重復(fù)陣列(IA)和Wallace樹型結(jié)構(gòu)，筆者就本文研究的32位浮點(diǎn)乘法采用了一種改進(jìn)的采用兩級(jí)流水線的4-2壓縮器和全加器混合使用的對(duì)稱Wallace樹型結(jié)構(gòu)完成13個(gè)部分積的相加，并重點(diǎn)給予闡述。接著討論了乘法器的功能模塊設(shè)計(jì)，其中包括：乘法器矩陣中的Booth編碼器，部分積產(chǎn)生電路，進(jìn)位選擇電路的邏輯設(shè)計(jì)原理。在比較了幾種常用的進(jìn)位傳遞加法器原理與結(jié)構(gòu)的基礎(chǔ)上，使用靜態(tài)Manc

溫馨提示

  • 1. 本站所有資源如無特殊說明，都需要本地電腦安裝OFFICE2007和PDF閱讀器。圖紙軟件為CAD,CAXA,PROE,UG,SolidWorks等.壓縮文件請(qǐng)下載最新的WinRAR軟件解壓。
  • 2. 本站的文檔不包含任何第三方提供的附件圖紙等，如果需要附件，請(qǐng)聯(lián)系上傳者。文件的所有權(quán)益歸上傳用戶所有。
  • 3. 本站RAR壓縮包中若帶圖紙，網(wǎng)頁內(nèi)容里面會(huì)有圖紙預(yù)覽，若沒有圖紙預(yù)覽就沒有圖紙。
  • 4. 未經(jīng)權(quán)益所有人同意不得將文件中的內(nèi)容挪作商業(yè)或盈利用途。
  • 5. 眾賞文庫僅提供信息存儲(chǔ)空間，僅對(duì)用戶上傳內(nèi)容的表現(xiàn)方式做保護(hù)處理，對(duì)用戶上傳分享的文檔內(nèi)容本身不做任何修改或編輯，并不能對(duì)任何下載內(nèi)容負(fù)責(zé)。
  • 6. 下載文件中如有侵權(quán)或不適當(dāng)內(nèi)容，請(qǐng)與我們聯(lián)系，我們立即糾正。
  • 7. 本站不保證下載資源的準(zhǔn)確性、安全性和完整性, 同時(shí)也不承擔(dān)用戶因使用這些下載資源對(duì)自己和他人造成任何形式的傷害或損失。

評(píng)論

0/150

提交評(píng)論