基于Tilera多核處理器的并行模型研究.pdf_第1頁
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文檔簡介

1、隨著近年來多核處理器技術的發(fā)展，處理器上集成的核數(shù)量越來越多，這就要求程序員必須掌握并行程序的開發(fā)技術。各種并行開發(fā)模型已經(jīng)比較成熟，如基于谷歌MapReduce思想和共享內存架構在多核處理器上實現(xiàn)的并行框架，獨立于語言的、與處理器和操作系統(tǒng)無關的核間通信接口 MCAPI都已經(jīng)開始使用。目前，使用多個低頻率的核經(jīng)過 Mesh網(wǎng)絡架構集成到一個處理器上已經(jīng)在處理性能上達到先進水平，而Tilera系列處理器就是其中的代表。
　　本文首

2、先研究了 Tilera多核處理器的架構和核間通信模型，其最大的特點就是基于二維iMesh網(wǎng)絡的系統(tǒng)架構和通信模型。其次，針對兩種通用并行編程模型MCAPI和Phoenix進行研究，并對其在Tilera多核處理器上進行了實現(xiàn)。最后，在Phoenix并行編程模型基礎上實現(xiàn)了并行化的圖像增強算法。
　　為了驗證并行算法在Tilera多核處理器上的效率，對在Tilera TILE-GX36上實現(xiàn)的MCAPI核間通信效率進行了測試。同時對P

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