異構(gòu)多核SoC中簇節(jié)點設(shè)計技術(shù)研究.pdf_第1頁
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文檔簡介

1、多核技術(shù)在集成電路產(chǎn)業(yè)中日益受到關(guān)注,以異類計算節(jié)點(如CPU、DSP、硬件加速器等)為特征的異構(gòu)多核SoC成為研究熱點之一。其中,根據(jù)應(yīng)用特征,設(shè)計計算簇節(jié)點架構(gòu)(如簇內(nèi)通訊架構(gòu)和硬件加速單元等)具有一定的探索空間。本文以異構(gòu)多核SoC中的計算簇節(jié)點為研究對象,著重考察CORDIC協(xié)處理器設(shè)計技術(shù),分析總線仲裁方法。
　　本文的主要工作如下:
　　1、評估基于浮點協(xié)處理器軟核的設(shè)計性能。以Microblaze軟核處理器中自

2、帶的浮點處理單元為分析對象,分析不同運算類型下的性能。實驗結(jié)果表明,該軟核浮點協(xié)處理器對于加、減、乘、除的浮點運算周期尚可接受,但對于正余弦、冪次方、方均根等運算的周期比較大。
　　2、設(shè)計基于CORDIC的浮點協(xié)處理器架構(gòu),給出常見計算操作的數(shù)據(jù)處理方案。通過實驗分析CORDIC算法對于浮點運算的能力,設(shè)計正余弦操作算法,并將CORDIC運算結(jié)果與實際數(shù)值進(jìn)行比較。實驗結(jié)果表明,采用16級流水線迭代CORDIC算法實現(xiàn)的正余弦函

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