基于FPGA的全數(shù)字?jǐn)U頻收發(fā)機(jī)的設(shè)計(jì)與實(shí)現(xiàn).pdf_第1頁(yè)
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1、軟件無(wú)線電(SDR)<'[1]>系統(tǒng)是利用軟件方式，控制可編程硬件來(lái)更改系統(tǒng)參數(shù)，以便適應(yīng)不同的需要。它有兩個(gè)核心思想，首先是將數(shù)字化區(qū)域由接收機(jī)推廣到發(fā)射機(jī)，并用數(shù)字方式實(shí)現(xiàn)了幾乎全部的基帶和中頻系統(tǒng)。其次就是將信號(hào)處理部分，諸如：調(diào)制解調(diào)、上/下變頻、濾波器設(shè)計(jì)等模塊全部構(gòu)建在硬件平臺(tái)上用軟件控制。而且隨著可編程器件(如：FP6A、DSP等)性能上的飛速提升，又使以上這一切的實(shí)現(xiàn)變得更加便捷和簡(jiǎn)易，所以結(jié)合擴(kuò)頻設(shè)計(jì)技術(shù)，設(shè)計(jì)一款基于

2、FPGA的全數(shù)字?jǐn)U頻收發(fā)機(jī)，便是本課題的主要研究目標(biāo)。 本文將首先從擴(kuò)頻收發(fā)機(jī)的關(guān)鍵技術(shù)入手，著重介紹其理論依據(jù)。隨后，基于這些理論知識(shí)以及部分專用直接序列擴(kuò)頻芯片的設(shè)計(jì)結(jié)構(gòu)，如：Z87200，HFA3824等，確定了本擴(kuò)頻收發(fā)機(jī)的實(shí)現(xiàn)方案，并結(jié)合本方案特點(diǎn)設(shè)計(jì)了一套完整的硬件測(cè)試平臺(tái)。它分為數(shù)字和模擬兩部分，其中以Altera Cyclone Ⅱ系列FPGA芯片EP2C35F672C6作為數(shù)字部分的硬件載體。同時(shí)分別采用ADI

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