高速QAM解調器的算法及VLSI實現研究.pdf_第1頁
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文檔簡介

1、本文主要研究高速QAM解調器的算法及其VLSI結構優(yōu)化與實現。本文的解調算法采用全數字實現,保證了算法的穩(wěn)定性,同時對算法進行改進提高了性能。在完成解調算法到VLSI結構的映射過程中,綜合考慮了電路的面積、速度與功耗,優(yōu)化了整體性能。 本文系統(tǒng)分析了全數字QAM解調器的體系結構,首先研究了QAM解調器中決定性能的四個關鍵環(huán)路,并分析這四個關鍵環(huán)路之間的相互影響;分析了影響QAM解調算法性能的關鍵因素,在此基礎上著重研究了載波頻偏

2、與信道失真的重要影響,提出一種結合均衡的載波恢復混合算法與結構;分析了傳輸信道對QAM解調器性能的影響,提出了一種改進的雙模式自適應均衡算法,使均衡器可在各種信道情況下獲得穩(wěn)定的性能;對自適應均衡器的抽頭部分以及抽頭系數更新部分分別進行了優(yōu)化設計,顯著減少了芯片面積;完成了高速QAM解調器算法的FPGA及VLSI芯片設計,芯片采用SMIC0.25μmCMOS混合信號工藝制造。論文給出了芯片的測試驗證方案,對芯片測試結果的分析表明,該芯片

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