基于網(wǎng)絡(luò)多核處理器的入侵防御系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn).pdf_第1頁(yè)
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1、通信網(wǎng)絡(luò)的高速發(fā)展，要求有高性能網(wǎng)絡(luò)設(shè)備的支持。同時(shí)，高性能的網(wǎng)絡(luò)設(shè)備要求更高性能的處理器。多核體系結(jié)構(gòu)通過(guò)增加計(jì)算機(jī)中物理處理器的數(shù)量，使程序達(dá)到真正并行執(zhí)行，是目前提高處理器性能的有效途徑。
　　 本文介紹了CPU從單核向多核發(fā)展的趨勢(shì)和MIPS體系結(jié)構(gòu)，深入剖析了MIPS64位多核OCTEON CPU的硬件結(jié)構(gòu)、軟件包處理流程和多核并行程序設(shè)計(jì)方法。針對(duì)OCTEON處理器研究了多核嵌入式軟件的加載和啟動(dòng)過(guò)程，分析了多核體系

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