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文檔簡介
1、本文在分析接入網(wǎng)網(wǎng)管匯聚端的基礎(chǔ)上，采用數(shù)字集成電路自上而下的設(shè)計方法進行了匯聚器設(shè)計。在詳細分析HDLC協(xié)議和SDRAM緩存規(guī)則的基礎(chǔ)上，對匯聚器進行了功能模塊劃分；采用硬件描述語言VHDL在行為級對匯聚器的項層和各個模塊進行了設(shè)計；使用Modelsim SE6．3對設(shè)計進行了編譯和功能仿真；利用EDA綜合集成工具ISE對匯聚器完成了綜合實現(xiàn)，并通過了測試，利用DC綜合工具在富士通cs86的標準單元工藝庫上實現(xiàn)了網(wǎng)表。 本設(shè)計
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