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1、該文設(shè)計(jì)了基于PCI總線的高速業(yè)務(wù)接入芯片中的數(shù)個(gè)核心電路模塊:多通道高速HDLC處理器、物理接口模塊和多通道高速數(shù)據(jù)緩沖區(qū)的管理和控制模塊.其中多通道HDLC處理器芯片模塊可以同時(shí)處理8個(gè)E1鏈路,最大128個(gè)邏輯通道.其基本工作原理是:首先對(duì)128個(gè)低速的HDLC通道的數(shù)據(jù)進(jìn)行緩沖,然后使用一個(gè)具有分時(shí)處理能力的高速HDLC處理器,通過(guò)時(shí)分復(fù)用的方式進(jìn)行數(shù)據(jù)的處理.該文設(shè)計(jì)的所有電路模塊均由Xilinx公司的FPGA—XV600-6
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