ieee802.16e標(biāo)準(zhǔn)ldpc譯碼器fpga設(shè)計(jì)與實(shí)現(xiàn)_第1頁(yè)
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1、西南交通大學(xué)碩士學(xué)位論文IEEE802.16e標(biāo)準(zhǔn)LDPC譯碼器FPGA設(shè)計(jì)與實(shí)現(xiàn)姓名：楊建平申請(qǐng)學(xué)位級(jí)別：碩士專業(yè)：通信與信息系統(tǒng)指導(dǎo)教師：陳慶春20100301西南交通大學(xué)碩士研究生學(xué)位論文第1I頁(yè)AbstractSincebeingrediscoveredin1990s，LDPCcodeshaveattractedpeople’Sattentionandhavebecomeanotherresearchfocusofchannel

2、codingfiledafterTurbocodesbecauseoftheircapacityapproachingerrorcorrectioncapabilityandtheadvantagesoflowdecodingcomplexityandhighdecodingthroughputTodayLDPCcodeshavebeenwidelyappliedindifferentcommunicationsystemssuchas

3、DVB—S2，CMMBandWiFiLDPCcodesaretheoptionalchannelcodingschemeintheIEEE80216estandardWiththeprogressintheLDPCcodesinrecentyears，thereisahighprobabilitythatLDPCcodeswillbeutilizedinthefuturefourthgenerationmobilecommunicati

4、onsystemsInthispaper，theFPGAdesignandimplementationoftheLDPCdecoderfortheIEEE80216estandardishighlighted，andthethesisisorganizedasfollowsFirstlytheerror—correctionperformanceanddecodingcomplexityofseveralsoftdecisiondeco

5、dingalgorithmsarepresentedtocomparetheachivedreliabilityandtheimplementationcomplexityFinallyitisshownthat，theOffsetMin—Sumalgorithmisareasonablechoiceforthehardwareimplementationduetoitsrealiabilityandlowimplementationc

6、omplexityMeanwhile，itisvalidatedthat，theoffsetfactor∥=O125andthefixedpointformof(6：3)ishighlyrecommendedthroughputthesoftwaresimulationsSecondly，afterthecomparisonoftheimplementationarchitectureofsomeknownLDPCdecodercode

7、cs，thepartiallyparallelarchitecture，whichmeetswiththequasi—cyclicLDPCdecodingnature，isadoptedasthebasicdecodingarchitectureMoreover，someimprovedmethodsarepresentedtomakethepartiallyparalleldecodingstructuretosupportnoton

8、lyallofthe6kindsofcoderateand19kindsofcodelengthspecifiedbytheIEEE80216estandard，butalsosupporttheconsecutiveblockdatadecodingprocessingandtheearlyiterationstoppingcriterionThirdly，theLDPCdesignandimplementationisvalidat

9、edontheModelSim—basedfunctionalsimulationtestplatform，andthensynthesizedontheStratixIIGXfamilyFPGAdevicesbyusingQuartusIIsoftwarekitAndthesynthesisresultsshowthat，therealizeddecodersupportsathroughputuptomorethan95Mbpsfo

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