集成電路中的芯片數(shù)量按照摩爾定律預(yù)測的速度飛速發(fā)展在集成電路的設(shè)計中需要尋求新的互連技術(shù)三維集成電路TSV硅通孔技術(shù)引起了廣泛關(guān)注。三維集成電路提出了一種全新的提高IC集成度的方法而TSV硅通孔技術(shù)作為一種全新的互連技術(shù)在三維集成電路中有著非常重要的作用...
下載價格：5 賞幣 / 發(fā)布人： 回首 / 發(fā)布時間：2024-03-09 / 4人氣
隨著集成電路工藝進(jìn)入納米尺寸，芯片功耗成為一個越來越重要的設(shè)計因素。根據(jù)最新的研究1表明，相對專用集成電路APPLICATIONSPECIFICINTEGRATEDCIRCUIT，ASIC，現(xiàn)場可編程門陣列器件FIELDPROGRAMMABLEGATEARRAY，F(xiàn)PGA實現(xiàn)相同功能電路的動態(tài)功耗是其7～14倍，靜態(tài)功...
下載價格：5 賞幣 / 發(fā)布人： 抱緊你的呵護(hù) / 發(fā)布時間：2024-03-09 / 3人氣
隨著制造工藝的發(fā)展，功耗成為集成電路設(shè)計中的一個十分關(guān)鍵的問題，傳統(tǒng)的低功耗設(shè)計主要圍繞動態(tài)功耗的估計和優(yōu)化展開。進(jìn)入深亞微米工藝后，出現(xiàn)了很多新的功耗問題，例如漏電流的迅猛增長引起了一系列新問題的產(chǎn)生。本文主要研究漏電流的估計和優(yōu)化以及與之相關(guān)...
下載價格：5 賞幣 / 發(fā)布人： 束縛 / 發(fā)布時間：2024-03-09 / 10人氣
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下載價格：5 賞幣 / 發(fā)布人： 歲月那么長 / 發(fā)布時間：2024-03-10 / 5人氣
低功耗設(shè)計方法,,內(nèi)容,CMOS電路的功耗來源影響功耗的因素低功耗設(shè)計方法工藝級的優(yōu)化技術(shù)版圖和晶體管級的優(yōu)化技術(shù)RTL級和邏輯級的優(yōu)化技術(shù)系統(tǒng)級的優(yōu)化技術(shù)采用HDL的低功耗設(shè)計流程,CMOS電路的功耗來源,在數(shù)字CMOS電路中，功耗是由三部分構(gòu)成的PTOTALPDYNAMICPSHORT...
下載價格：4 賞幣 / 發(fā)布人： 畢業(yè)設(shè)計 / 發(fā)布時間：2024-01-06 / 5人氣
西安電子科技大學(xué)碩士學(xué)位論文TSV功耗建模與3DNOC功耗分析作者江鵬導(dǎo)N蔡覺平教授學(xué)科微電子學(xué)與固體電子學(xué)中國西安2012年1月TSVPOWERMODELAND3DNOCPOWERCONSUMPTIONANALYSISL●，ADISSERTATIONSUBMITTEDTOXIDIANUNIVERSITYINCANDIDACYFORTHEDEGREEOFMASTERINMICROELE...
下載價格：5 賞幣 / 發(fā)布人： 如同昨日 / 發(fā)布時間：2024-03-10 / 9人氣
近年來，處理器的性能依然遵循摩爾定律不斷提高，功耗也隨之增加。各類便攜智能終端和移動通訊設(shè)備迅速普及，人們對移動計算的要求越來越高。這些移動計算設(shè)備通常采用電池作為重要的電力來源，而電池技術(shù)近年來沒有重大突破。如何降低功耗，以便在有限的體積、重量...
下載價格：5 賞幣 / 發(fā)布人： 停杯 / 發(fā)布時間：2024-03-10 / 11人氣
近40年來，集成電路工業(yè)一直依循莫爾定律而發(fā)展，即集成電路的規(guī)模每三年翻兩番。作為集成電路最新技術(shù)的代表，SOCSYSTEMONCHIP，片上系統(tǒng)已經(jīng)成為集成電路設(shè)計領(lǐng)域的研究熱點并得到越來越廣泛的應(yīng)用。深亞微米工藝SOC芯片設(shè)計除了要考慮傳統(tǒng)的性能和成本的要求并得...
下載價格：5 賞幣 / 發(fā)布人： 披血男巫 / 發(fā)布時間：2024-03-10 / 4人氣
復(fù)旦大學(xué)碩士學(xué)位論文低功耗物理設(shè)計姓名郭小川申請學(xué)位級別碩士專業(yè)電子與通信工程指導(dǎo)教師曾曉洋20070526摘要在20世紀(jì)，IC設(shè)計者主要關(guān)注速度、面積、成本、可靠性，其次才是功耗。而進(jìn)入21世紀(jì)，無線通訊產(chǎn)品和掌上電腦類便攜產(chǎn)品需要有限的電池容量可以支持盡可...
下載價格：5 賞幣 / 發(fā)布人： 提詞深情喂風(fēng) / 發(fā)布時間：2024-03-10 / 5人氣
該文首先從系統(tǒng)結(jié)構(gòu)的角度對嵌入式系統(tǒng)的存儲層次的功耗進(jìn)行研究分析研究了兩類流行的系統(tǒng)級功耗優(yōu)化方法代碼壓縮和CACHING并在此基礎(chǔ)上提出了改進(jìn)的LOOPTABLE功耗優(yōu)化方法代碼壓縮方法通過對程序目標(biāo)代碼進(jìn)行重新編碼來減小程序所占用的存儲器尺寸減小訪存帶寬降低...
下載價格：5 賞幣 / 發(fā)布人： 智者 / 發(fā)布時間：2024-03-09 / 6人氣
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下載價格：5 賞幣 / 發(fā)布人： 青絲盼 / 發(fā)布時間：2024-03-10 / 6人氣
本論文研究和分析了低功耗設(shè)計技術(shù)的背景、功耗的組成和降低功耗的方法途徑。目前主要是通過降低工作電壓、降低電容和減小活動性來達(dá)到降低功耗的目的。低功耗設(shè)計大致分為系統(tǒng)結(jié)構(gòu)級、寄存器傳輸級、門級、電路級四個層次，按照自頂向下的電路設(shè)計方法，在不同設(shè)計...
下載價格：5 賞幣 / 發(fā)布人： 空曠 / 發(fā)布時間：2024-03-10 / 4人氣
密碼模塊部分是信息安全系統(tǒng)的關(guān)鍵部件，其安全性的高低直接關(guān)乎整個信息系統(tǒng)的安全。21世紀(jì)以前的大部分時間，對密碼模塊的攻擊主要集中在數(shù)學(xué)分析上，主要是是以線性攻擊和差分攻擊為代表的傳統(tǒng)密碼分析方法，通過利用密碼算法的統(tǒng)計特性，通過分析所選擇的明密文...
下載價格：5 賞幣 / 發(fā)布人： 妄手摘圖星 / 發(fā)布時間：2024-03-09 / 6人氣
1/4低功耗數(shù)字壓力表數(shù)字壓力表結(jié)合了微處理技術(shù)和先進(jìn)的模數(shù)轉(zhuǎn)換算法,達(dá)到高精度、低功耗的要求大屏幕液晶顯示技術(shù)，獨特的背景燈技術(shù)，使數(shù)據(jù)在夜晚也能清晰易讀。采用進(jìn)口芯片，對儀表數(shù)據(jù)采集、記憶、測量保持峰值,手動回零。外殼采用不銹鋼全密封,耐腐蝕、抗震...
下載價格：3 賞幣 / 發(fā)布人： 兩難 / 發(fā)布時間：2024-05-22 / 0人氣
磁力軸承是利用磁力作用將轉(zhuǎn)子懸浮于空間，使轉(zhuǎn)子與定子之間沒有機械接觸的一種高性能軸承。已被廣泛用于機械加工、航空航天、真空技術(shù)等領(lǐng)域，被公認(rèn)為是具有廣泛應(yīng)用前景的新型軸承。磁力軸承在工作過程產(chǎn)生的功耗導(dǎo)致磁懸浮轉(zhuǎn)子溫度升高，而磁懸浮轉(zhuǎn)子的溫升問題...
下載價格：5 賞幣 / 發(fā)布人： 因果 / 發(fā)布時間：2024-03-11 / 7人氣
高速模數(shù)轉(zhuǎn)換器是一些系統(tǒng)中至為關(guān)鍵的模塊，如磁盤驅(qū)動讀寫系統(tǒng)，超寬帶UWB，ULTRAWIDEB通信系統(tǒng)和光纖通信等，在這些系統(tǒng)中需要高采樣率和中低分辨率的ADC。同時，低功耗設(shè)計也是ADC設(shè)計中一個非常重要的方面。在所有的高速ADC中，全并行FLASHADC由于其優(yōu)越的高速...
下載價格：5 賞幣 / 發(fā)布人： 你個廢物 / 發(fā)布時間：2024-03-11 / 19人氣
該文的研究背景是為面向低功耗的SOC系統(tǒng)設(shè)計中的體系結(jié)構(gòu)優(yōu)化和軟件編譯器優(yōu)化提供支持從這個角度出發(fā)該文提出了一種包含指令級功耗模型和部件級功耗模型在內(nèi)的兩層系統(tǒng)級功耗模型部件級功耗模型是系統(tǒng)級功耗模型的基礎(chǔ)它根據(jù)部件的結(jié)構(gòu)信息自底向上的計算各個部件的...
下載價格：5 賞幣 / 發(fā)布人： 無力反抗 / 發(fā)布時間：2024-03-10 / 8人氣
在電子技術(shù)飛速發(fā)展的今天，VLSI系統(tǒng)規(guī)模越來越大，集成度越來越高，功耗的影響越來越被人們所重視。尤其是便攜式設(shè)備的廣泛流行，由于電池的限制，要想有較長的使用時間，就必須考慮低功耗的問題。另一方面OFDM技術(shù)在通訊領(lǐng)域中廣泛應(yīng)用，由于它能夠非常有效的對抗...
下載價格：5 賞幣 / 發(fā)布人： 反復(fù)回蕩 / 發(fā)布時間：2024-03-12 / 11人氣
不斷縮小的工藝尺寸和超高的集成度使得集成在芯片上的晶體管數(shù)目急劇增加、功能越來越復(fù)雜給VLSI測試帶來了更加嚴(yán)峻的挑戰(zhàn)。測試數(shù)據(jù)量大和測試功耗高是VLSI測試中的兩大主要問題它們已經(jīng)嚴(yán)重影響了測試成本研究高壓縮率、低測試功耗的測試方法對降低測試成本十分重...
下載價格：5 賞幣 / 發(fā)布人： 我心非石 / 發(fā)布時間：2024-03-07 / 9人氣
本文概述了研究課題的背景。介紹了低功耗技術(shù)是集成電路設(shè)計的重要研究方向之一，也是論文在研究課題選擇的重要依據(jù)。接著詳細(xì)分析CMOS功耗的來源，并得出動態(tài)功耗是主要的功耗來源。隨后深入分析了低功耗技術(shù)的現(xiàn)狀首先從原理上分析實現(xiàn)低功耗設(shè)計的理論方法，得出...
下載價格：5 賞幣 / 發(fā)布人： 臭臉 / 發(fā)布時間：2024-03-10 / 4人氣
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