基于FPGA的直接數字頻率合成器設計.pdf_第1頁
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文檔簡介

1、信號發(fā)生器被廣泛應用于眾多的電子儀器設備中,在較為傳統(tǒng)的信號發(fā)生器設計方法中,往往采用分立元件或通用的數字電路元件進行設計實現,然而,這些傳統(tǒng)的設計方法普遍具有花費大,設計周期長,可移植性差的缺點。本文旨在描述一種利用 EDA技術設計信號發(fā)生器的方法,該信號發(fā)生器由兩個主要功能模塊組成(波形生成模塊和指令控制模塊),能夠在上位機的控制下,輸出特定參數(頻率,幅度,相位)的正弦波,鋸齒波,三角波,輸出的信號頻率為97KHz至6.25MHz

2、,信號幅度的變化范圍為0~2.5/3.3V。
　　電子系統(tǒng)的集成化,不但可以使電子設備的重量大為減小,功耗大大降低,體積大大減小,更重要的是可以使設備的可靠性大大提高,本文開頭詳細敘述了頻率合成器的發(fā)展史,對使用現場可編程門陣列(FPGA)實現 DDS技術的意義進行了闡述,然后介紹了 DDS的基本原理、結構及特點,側重敘述了用 FPGA來完成直接數字頻率合成器(DDS)并通過上位機對系統(tǒng)工作狀態(tài)進行控制的設計方法。最后通過使用 V

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