2023年全國(guó)碩士研究生考試考研英語(yǔ)一試題真題（含答案詳解+作文范文）_第1頁(yè)
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文檔簡(jiǎn)介

1、近年來射頻技術(shù)尤其是無(wú)線通信系統(tǒng)的蓬勃發(fā)展推動(dòng)了低成本、低功耗CMOS無(wú)線收發(fā)機(jī)的研究與應(yīng)用。PLL(Phase Lock Loop)頻率合成器的一個(gè)重要應(yīng)用就是為無(wú)線收發(fā)機(jī)中的混頻器提供本振信號(hào)。對(duì)于從MHz到GHz的不同頻段，PLL頻率合成器都擔(dān)當(dāng)著重要的角色。
　　 隨著CMOS工藝的不斷進(jìn)步，低成本的CMOS器件已經(jīng)能滿足多數(shù)無(wú)線通信應(yīng)用的要求。CMOS工藝還可以在同一塊管芯上集成數(shù)字電路部分，在功能的設(shè)計(jì)上靈活性更高。

2、
　　 本論文主要是在鎖相環(huán)基本理論的基礎(chǔ)上，結(jié)合產(chǎn)品的要求，在SMIC0.35um工藝上設(shè)計(jì)了用于低端無(wú)繩電話射頻收發(fā)芯片的45M/48M鎖相環(huán)頻率合成器。其中接收機(jī)鎖相環(huán)在CP(Charge Pump)沖放電電流為1mA的情況下，整體電路動(dòng)態(tài)功耗小于2.5mA，spur小于-60dBc，鎖定時(shí)間小于3ms，性能符合接收機(jī)電路系統(tǒng)要求，模擬部分版圖面積為210um×310um。發(fā)射機(jī)鎖相環(huán)模擬部分版圖面積大概為260um×14

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